新学年天津大学《数字逻辑》在线作业一

奥鹏天津大学平时在线作业

《数字逻辑》在线作业一

计数器是对脉冲的个数进行计数，具有计数功能的电路
A:正确
B:错误
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时序电路不含有记忆功能的器件。
A:正确
B:错误
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反馈清零法是在计数过程中利用某个中间状态反馈到清零端，迫使计数器返回到0，再重新开始计数
A:正确
B:错误
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A:A
B:B
C:C
D:D
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有一T 触发器，在 T=1 时，加上时钟脉冲，则触发器（）
A:保持原态
B:置 0
C:置 1
D:翻转
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同步计数器和异步计数器比较，同步计数器的显著优点是
A:工作速度高
B:触发器利用率高
C:电路简单
D:不受时钟CP控制
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要构成5进制计数器，至少需要（）个触发器
A:0
B:1
C:2
D:3
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A:A
B:B
C:C
D:D
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一位8421BCD码计数器至少需要（）个触发器
A:3
B:4
C:5
D:10
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同步二进制计数器的电路比异步二进制计数器复杂，所以实际应用中较少使用同步二进制计数器
A:正确
B:错误
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利用四位右移寄存器串行输入寄存1010，清零之后应首先输入()
A:0
B:1
C:2
D:3
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构成一个7进制计数器需要三个触发器
A:正确
B:错误
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74LS290是同步和异步非二进制计数器
A:正确
B:错误
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有8个触发器数目的二进制计数器，它具有256个计数状态。
A:正确
B:错误
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异步时序电路的各级触发器类型不同。
A:正确
B:错误
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3位二进制计数器可以构成模值为9的计数器。
A:正确
B:错误
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当时序电路存在无效循环时该电路不能自启动
A:正确
B:错误
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寄存器的功能是记忆多位二进制数
A:正确
B:错误
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把一个五进制计数器与一个四进制计数器串联可得到（）进制计数器
A:4
B:5
C:9
D:20
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寄存器取出数据的方式有并行和串行输出两种
A:正确
B:错误
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当用异步I/O输出结构的PAL设计逻辑电路时，它们相当于（）
A:组合逻辑电路
B:时序逻辑电路
C:存储器
D:数模转换器
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同步时序电路由组合电路和存储器两部分组成。
A:正确
B:错误
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在各种寄存器中，存放N位二进制数码需要()个触发器
A:0
B:1
C:N
D:N+1
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五个D触发器构成环形计数器，其计数长度为（）
A:5
B:10
C:25
D:32
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PLD器件的主要优点不包括（）
A:便于仿真测试
B:集成密度低
C:可硬件加密
D:可改写
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二进制加法计数器从0计数到十进制24时，需要5个触发器构成，有7个无效状态。
A:正确
B:错误
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在同步时序电路的设计中，若最简状态表中的状态数为2^N，而又是用N级触发器来实现其电路，则不需检查电路的自启动性。
A:正确
B:错误
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PROM和PAL的结构是（）
A:PROM的与阵列固定，不可编程
B:PROM与阵列、或阵列均不可编程
C:PAL与阵列、或阵列均可编程
D:PAL的与阵列不可编程
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时序电路不含有记忆功能的器件
A:正确
B:错误
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74LS161是异步二进制计数器
A:正确
B:错误
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米里型时序逻辑电路的输出是（）
A:只与输入有关
B:只与电路当前状态有关
C:与输入和电路当前状态均有关
D:与输入和电路当前状态均无关
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要产生10个顺序脉冲，若用四位双向移位寄存器CT74LS194来实现，需要（）片
A:3
B:4
C:5
D:10
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环形计数器在每个时钟脉冲CP作用时，仅有一位触发器发生状态更新
A:正确
B:错误
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N个触发器可以构成能寄存（）位二进制数码的寄存器
A:N-1
B:N
C:N+1
D:2N
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环形计数器如果不作自启动修改，则总有孤立状态存在。
A:正确
B:错误
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同步时序电路和异步时序电路比较，其差异在于后者（）
A:没有触发器
B:没有统一的时钟脉冲控制
C:没有稳定状态
D:输出只与内部状态有关
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在同步计数器中，各触发器的CP输入端应接统一的时钟脉冲
A:正确
B:错误
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GAL的输出电路是（）
A:OLMC
B:固定的
C:只可一次编程
D:不可重复编程
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下列逻奥鹏天津大学平时在线作业辑电路中为时序逻辑电路的是（）
A:变量译码器
B:加法器
C:数码寄存器
D:数据选择器
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计数器可用于累计输入脉冲个数，分频，定时，执行数字运算等，应用广泛
A:正确
B:错误
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