新学年天津大学《数字逻辑》在线作业二

奥鹏天津大学平时在线作业

《数字逻辑》在线作业二

某电视机水平-垂直扫描发生器需要一个分频器将31500HZ的脉冲转换为60HZ的脉冲，欲构成此分频器至少需要（）个触发器。
A:10
B:60
C:525
D:31500
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时序电路不含有记忆功能的器件
A:正确
B:错误
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异步时序电路的各级触发器类型不同。
A:正确
B:错误
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N个触发器可以构成能寄存（）位二进制数码的寄存器。
A:N-1
B:N
C:N+1
D:2N
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计数器的模是指对输入的计数脉冲的个数。
A:正确
B:错误
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要产生10个顺序脉冲，若用四位双向移位寄存器CT74LS194来实现，需要（）片
A:3
B:4
C:5
D:10
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8位移位寄存器，串行输入时经（）个脉冲后，8位数码全部移入寄存器中
A:1
B:2
C:4
D:8
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PLD器件的基本结构组成不包括（）
A:与阵列
B:或阵列
C:输入缓冲电路
D:输出缓冲电路
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N进制计数器可以实现N分频
A:正确
B:错误
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寄存器要存放n位二进制数码时，需要2^n个触发器
A:正确
B:错误
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二进制加法计数器从0计数到十进制24时，需要5个触发器构成，有7个无效状态。
A:正确
B:错误
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假设 JK 触发器的现态 Qn=0，要求 Qn+1=0，则应使（）
A:J=，K=0
B:J=0，K=
C:J=1，K=
D:J=K=1
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时序电路不含有记忆功能的器件。
A:正确
B:错误
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GAL的输出电路是（）
A:OLMC
B:固定的
C:只可一次编程
D:不可重复编程
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A:A
B:B
C:C
D:D
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只可进行一次编程的可编程器件有（）
A:PAL
B:GAL
C:PROM
D:A和C
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A:A
B:B
C:C
D:D
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某移位寄存器的时钟脉冲频率为100KHZ，欲将存放在该寄存器中的数左移8位，完成该操作需要（）时间。
A:10us
B:80us
C:100us
D:800ms
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欲设计0，1，2，3，4，5，6，7这几个数的计数器，如果设计合理，采用同步二进制计数器，最少应使用（）级触发器
A:2
B:3
C:4
D:8
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有8个触发器数目的二进制计数器，它具有256个计数状态。
A:正确
B:错误
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同步计数器和异步计数器比较，同步计数器的显著优点是
A:工作速度高
B:触发器利用率高
C:电路简单
D:不受时钟CP控制
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环形计数器在每个时钟脉冲CP作用时，仅有一位触发器发生状态更新。
A:正确
B:错误
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一位8421BCD码计数器至少需要（）个触发器
A:3
B:4
C:5
D:10
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实验中用的功能较强的74LS194是（）
A:右移寄存器
B:左移寄存器
C:双向移位寄存器
D:数码寄存器
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要构成5进制计数器，至少需要（）个触发器
A:0
B:1
C:2
D:3
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计数器的模是指对输入的计数脉冲的个数
A:正确
B:错误
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同步时序电路具有统一的时钟CP控制。
A:正确
B:错误
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74LS194是单向移位寄存器
A:正确
B:错误
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触发器有2个稳定状态
A:正确
B:错误
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74LS290是同步和异步非二进制计数器
A:正确
B:错误
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A:A
B:B
C:C
D:D
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环形计数器如果不作自启动修改，则总有孤立状态存在。
A:正确
B:错误
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环形计数器在每个时钟脉冲CP作用时，仅有一位触发器发生状态更新
A:正确
B:错误
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PLD器件的主要优点不包括（）
A:便于仿真测试
B:集成密度低
C:可硬件加密
D:可改写
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可重复进行编程的可编程器件有（）
A:PAL
B:ISP-PLD
C:PROM
D:B和C
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寄存器是组合逻辑器件
A:正确
B:错误
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同步时序电路由组合电路和存储器两部分组成。
A:正确
B:错误
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寄存器的功能是记忆多位二进制数
A:正确
B:错误
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同步二进制计数器的电路比异步二进制计数器复杂，所以实际应用中较少使用同步二进制计数器
A:正确
B:错误
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同步计数器和异步计数器比较，同步计数器的显著优点是（）
A:工作速度高
B:触发器利用率高
C:电路简单不受时钟CP控制
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