北京交通大学数字电子技术(含实验)期末考试题集

奥鹏期末考核

124231–数字电子技术(含实验)-北交期末考试复习题合集

单选题：
（1）某通信系统每秒传输1544000位数据，每位数据的时间（ ）。
A.324ns
B.628ns
C.1256ns
D.2312ns
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（2）对于TTL与非门闲置输入端的处理，不可（ ）。
A.接电源
B.通过电阻33k接电源
C.接地
D.与有用输入端并联
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（3）二进制是以（ ）为基数的计数体制。
A.数字
B.两位
C.高低电平
D.2
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（4）
A.
B.
C.
D.
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（5）组合逻辑电路消除竞争冒险的方法有（）。
A.修改逻辑设计
B.在输出端接入缓冲电路
C.后级加缓冲电路
D.屏蔽输入信号的尖峰干扰
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（6）常用的BCD码有( )。
A.奇偶校验码
B.格雷码
C.8421码
D.汉明码
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（7）在何种输入情况下，“与非”运算的结果是逻辑0( )。
A.全部输入是0
B.任一输入是0
C.仅一输入是0
D.全部输入是1
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（8）二、十进制码就是用（）位二进制数来表示（ ）位十进制数中的0~9这十个数码，简称BCD码。
A.4、2
B.4、1
C.2、1
D.2、2
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（9）下列逻辑电路中为时序逻辑电路的是（）。
A.变量译码器
B.加法器
C.数码寄存器
D.数据选择器
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（10）任何组合逻辑电路都可以变换成为（ ）表达式。
A.与或
B.与非
C.或非
D.非门
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（11）将（133）D转换为二进制数为（ ）。
A.（10000101）D
B.（10100101）D
C.（11000101）D
D.（10010101）D
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（12）以下电路中，加以适当辅助门电路，（）适于实现单输出组合逻辑电路。
A.奇偶校验器
B.数据选择器
C.数值比较器
D.七段显示译码器
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（13）边沿式D触发器是一种（ ）稳态电路。
A.无
B.单
C.双
D.多
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（14）A+BC=（ ）。
A.A+B
B.A+C
C.（A+B）（A+C）
D.B+C
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（15）数字信号只有两个取值，故称为（ ）。
A.二值信号
B.高低信号
C.0、1信号
D.有无信号
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（16）用555定时器组成施密特触发器，当输入控制端CO外接10V电压时，回差电压为（ ）。
A.3.33V
B.5V
C.6.66V
D.10V
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（17）典型的集成PLA（82S100）有（ ）输入变量。
A.8
B.16
C.24
D.48
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（18）利用逻辑代数的基本公式，可把任一个逻辑函数化成若干个最小项之和的形式称为（）。
A.最小项表达式
B.综合表达式
C.通用表达式
D.逻辑表达式
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（19）计算两个二进制数1010和0101的和为（ ）。
A.1111
B.1101
C.1011
D.1110
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（20）当A和B都是1位数时，它们只能取（ ）和（ ）两种值。
A.0、0
B.0、1
C.1、1
D.1、2
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（21）二、十进制码就是用（ ）位二进制数来表示（ ）位十进制数中的0~9这十个数码，简称BCD码。
A.4、2
B.4、1
C.2、1
D.2、2
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（22）常用BCD码有( )。
A.奇偶校验码
B.格雷码
C.8421码
D.汉明码
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（23）完成1位二进制数相加的一种组合逻辑电路（ ）。
A.半加器
B.全加器
C.1位加法器
D.多为加法器
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（24）要使TTL与非门工作在转折区，可使输入端对地外接电阻RI（）。
A.RON
B.ROFF
C.ROFFRIRON
D.ROFF
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（25）（ ）是一种对脉冲电平敏感的存储单元电路。
A.寄存器
B.锁存器
C.触发器
D.定时器
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（26）为实现将JK触发器转换为D触发器，应使（ ）。
A.J=D,K=/D
B.K=D,J=/D
C.J=K=D
D.J=K=/D
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（27）设周期性数字波形的高电平持续6ms，低电平持续10ms，占空比为（ ）。
A.60%
B.47.5%
C.37.5%
D.30%
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（28）下列触发器中，没有约束条件的是（ ）。
A.基本RS触发器
B.主从RS触发器
C.同步RS触发器
D.边沿D触发器
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（29）8位移位寄存器，串行输入时经（）个脉冲后，8位数码全部移入寄存器中。
A.1
B.2
C.4
D.8
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（30）逻辑关系为“一件事情的发生是以其相反的条件为依据”的逻辑运算是（ ）。
A.与奥鹏期末考核运算
B.或运算
C.非运算
D.错误说法
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（31）数字系统中用来存储二进制数据的逻辑部件是（）。
A.寄存器
B.计数器
C.触发器
D.定时器
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（32）具有译码功能的电路称为（）。
A.译码器
B.编码器
C.混编器
D.显示器
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（33）Verilog语言大概提供了约（ ）个运算符。
A.20
B.30
C.40
D.50
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（34）程序控制中，常用下列哪种电路作定时器？（ ）。
A.比较器
B.计数器
C.译码器
D.编码器
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（35）二进制数11011010转换成十进制数是（ ）。
A.216
B.118
C.218
D.318
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（36）函数F(A,B,C)=AB+BC+AC的最小项表达式为（ ）。
A.F(A,B,C)=∑m（0，2，4）
B.F (A,B,C)=∑m（3，5，6，7）
C.F(A,B,C)=∑m（0，2，3，4）
D.F(A,B,C)=∑m（2，4，6，7）
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（37）以下PLD中，与.或阵列均可编程的是下列哪一个器件？（ ）。
A.PROM
B.PAL
C.PLA
D.GAL
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（38）硅开关二极管导通时的正向压降为（ ）。
A.0.5V
B.0.7V
C.0.1V
D.0.3V
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（39）EEPROM是指（ ）。
A.随机读写存储器
B.一次编程的只读存储器
C.可擦可编程只读存储器
D.电可擦可编程只读存储器
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（40）电平异步时序逻辑电路不允许两个或两个以上输入信号（ ）。
A.同时为0
B.同时为1
C.同时改变
D.同时作用
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（41）下列逻辑门中，（ ）可以实现三种基本运算。
A.与门
B.或门
C.非门
D.与非门
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（42）已知74LS138译码器的输入三个使能端（E1=1， E2A = E2B=0）时，地址码A2A1A0=011，则输出 Y7 ～Y0是（ ）。
A.11111101
B.10111111
C.11110111
D.11111111
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（43）n个变量的逻辑函数应该有最小项（）个。
A.2n+1
B.n的2次方
C.2n
D.2n-1
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（44）函数F(A,B,C)=AB+BC+AC的最小项表达式为（ ）。
A.F(A,B,C)=∑m（0，2，4）
B.F (A,B,C)=∑m（3，5，6，7）
C.F(A,B,C)=∑m（0，2，3，4）
D.F(A,B,C)=∑m（2，4，6，7）
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（45）硅开关二极管导通时的正向压降为（ ）。
A.0.5V
B.0.7V
C.0.1V
D.0.3V
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（46）EEPROM是指（ ）。
A.随机读写存储器
B.一次编程的只读存储器
C.可擦可编程只读存储器
D.电可擦可编程只读存储器
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（47）电平异步时序逻辑电路不允许两个或两个以上输入信号（ ）。
A.同时为0
B.同时为1
C.同时改变
D.同时作用
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（48）由n个变量构成的最大项，有（ ）种取值组合使其值为1。
A.n
B.2n
C.
D.
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（49）用卡诺图化简包含无关条件的逻辑函数时，对无关最小项（ ）。
A.不应考虑
B.令函数值为1
C.令函数值为0
D.根据化简的需要令函数值为0或者1
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（50）下列逻辑门中，（ ）可以实现三种基本运算。
A.与门
B.或门
C.非门
D.与非门
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（51）数字电路中，当晶体管的饱和深度变浅时，其工作速度（ ）。
A.变低
B.变高
C.不变
D.加倍
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（52）有一个左移移位寄存器，当预先置入1011后，其串行输入固定接0，在4个移位脉冲CP作用下，四位数据的移位过程是（ ）。
A.1011–0110–1100–1000–0000
B.1011–0101–0010–0001–0000
C.1011–1100–1101–1110–1111
D.1011–1010–1001–1000–0111
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（53）n个变量的逻辑函数应该有最小项（）个。
A.2n+1
B.n的2次方
C.2n
D.2n-1
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（54）一只四输入端或非门，使其输出为1的输入变量取值组合有( )种。
A.15
B.8
C.7
D.1
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（55）随机存取存储器具有( )功能。
A.读/写
B.无读/写
C.只读
D.只写
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（56）N个触发器可以构成最大计数长度（进制数）为( )的计数器。
A.N
B.2N
C.N2
D.2N
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（57）标准与-或表达式是由（）构成的逻辑表达式。
A.与项相或
B.最小项相或
C.最大项相与
D.或项相与
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（58）设计一个模10计数器需要（）个触发器。
A.3
B.4
C.6
D.10
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（59）表示任意两位无符号十进制数至少需要（）个二进制数。
A.6
B.7
C.8
D.9
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（60）8线—3线优先编码器的输入为I0—I7 ，当优先级别最高的I7有效时，其输出的值是（）。
A.111
B.010
C.000
D.101
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（61）十六路数据选择器的地址输入（选择控制）端有（）个。
A.16
B.2
C.4
D.8
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（62）常用的BCD码有( )。
A.奇偶校验码
B.格雷码
C.8421码
D.汉明码
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（63）下列触发器中,没有约束条件的是( )。
A.基本RS触发器
B.主从RS触发器
C.同步RS触发器
D.边沿D触发器
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（64）欲使JK触发器按Qn+1=Qn工作,可使JK触发器的输入端( )。
A.J=K=1
B.J=Q,K=/Q
C.J=/Q ,K=Q
D.J=Q,K=1
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（65）N个触发器可以构成最大计数长度(进制数)为( )的计数器。
A.N
B.2N
C.N的平方
D.2的N次方
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（66）一个16选一的数据选择器,其地址输入(选择控制输入)端有( )个。
A.1
B.2
C.4
D.16
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（67）在何种输入情况下,“与非”运算的结果是逻辑0( )。
A.全部输入是0
B.任一输入是0
C.仅一输入是0
D.全部输入是1
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（68）以下代码中为恒权码的为( )。
A.循环码
B.5421BCD码
C.余三码
D.格雷码
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（69）边沿式D触发器是一种( )稳态电路。
A.无
B.单
C.双
D.多
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（70）一位十六进制数可以用( )位二进制数来表示。
A.1
B.2
C.4
D.16
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（71）组合逻辑电路消除竞争冒险的方法有( )。
A.修改逻辑设计
B.在输出端接入缓冲电路
C.后级加缓冲电路
D.屏蔽输入信号的尖峰干扰
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（72）为实现将JK触发器转换为D触发器,应使( )。
A.J=D,K=/D
B.K=D,J=/D
C.J=K=D
D.J=K=/D
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（73）欲使JK触发器按Qn+1=1工作,可使JK触发器的输入端( )
A.J=K=1
B.J=1,K=0
C.J=K=/Q或B
D.J=K=0
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（74）与八进制数(47.3)8等值的数为( )。
A.(100111.011)2
B.(27.8)16
C.(27.3)16
D.(100111.11)2
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（75）对于D触发器,欲使Qn+1=Qn,应使输入D=( )。
A.0
B.1
C.Qn
D./ Qn
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（76）对于JK触发器,若J=K,则可完成( )触发器的逻辑功能。
A.RS
B.D
C.T
D.T'
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（77）在下列逻辑电路中,不是组合逻辑电路的有( )。
A.译码器
B.编码器
C.全加器
D.寄存器
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（78）描述触发器的逻辑功能的方法不包括( )。
A.状态转换表
B.特性方程
C.状态转换图
D.状态方程
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（79）卡诺图上变量的取值顺序是采用( )的形式,以便能够用几何上的相邻关系表示逻辑上的相邻。
A.二进制码
B.循环码
C.ASCII码
D.十进制码
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（80）若一个逻辑函数由三个变量组成,则最小项共有( )个。
A.3
B.4
C.6
D.8
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（81）仅具有“置0”“置1”功能的触发器叫( )。
A.JK触发器
B.RS触发器
C.D触发器
D.T触发器
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（82）仅具有“保持”“翻转”功能的触发器叫( )。
A.JK触发器
B.T触发器
C.D触发器
D.RS触发器
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（83）仅具有“翻转”功能的触发器叫( )。
A.JK触发器
B.触发器
C.D触发器
D.RS触发器
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（84）JK触发器用作触发器时,控制端J、K正确接法是( )。
A.
B.
C.
D.
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（85）D触发器用作触发器时,控制端D的正确接法是( )。
A.
B.
C.
D.
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（86）下列各式中哪个是三变量A、B、C的最小项( )。
A.
B.
C.
D.
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（87）接成计数状态存在空翻问题的触发器是( )
A.D触发器
B.钟控RS触发器
C.主从RS触发器
D.基本RS触发器
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（88）时序电路输出状态的改变( )
A.仅与该时刻输入信号的状态有关
B.仅与时序电路的原状态有关
C.
D.
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（89）通常寄存器应具有( )功能。
A.存数和取数
B.清零与置数
C.A和B两者皆有
D.只有存数.取数和清零,没有置数。
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（90）按数码的存取方式,寄存器可分为( )
A.数码寄存器.移位寄存器
B.同步寄存器.异步寄存器
C.双向移位寄存器
D.主从.维持阻塞型
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（91）移位寄存器可分为( )
A.左移位寄存器
B.右移位寄存器
C.左.右移位和双向移位寄存器
D.TTL、MOS型
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（92）程序控制中,常用下列哪种电路作定时器?()
A.比较器
B.计数器
C.译码器
D.编码器
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（93）二进制数11011010转换成十进制数是()。
A.216
B.118
C.218
D.318
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（94）硅开关二极管导通时的正向压降为()。
A.0.5V
B.0.7V
C.0.1V
D.0.3V
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（95）EEPROM是指()。
A.随机读写存储器
B.一次编程的只读存储器
C.可擦可编程只读存储器
D.电可擦可编程只读存储器
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（96）电平异步时序逻辑电路不允许两个或两个以上输入信号()。
A.同时为0
B.同时为1
C.同时改变
D.同时作用
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（97）由n个变量构成的最大项,有()种取值组合使其值为1。
A.n
B.2n
C.
D.
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（98）数字电路中,当晶体管的饱和深度变浅时,其工作速度()。
A.变低
B.变高
C.不变
D.加倍
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（99）有一个左移移位寄存器,当预先置入1011后,其串行输入固定接0,在4个移位脉冲CP作用下,四位数据的移位过程是()。
A.1011–0110–1100–1000–0000
B.1011–0101–0010–0001–0000
C.1011–1100–1101–1110–1111
D.1011–1010–1001–1000–0111
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（100）
A.11111101
B.10111111
C.11110111
D.11111111
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（101）多谐振荡器有().
A.两个稳定状态
B.一个稳定状态,一个暂稳态
C.两个暂稳态
D.记忆二进制数的功能
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（102）一只四输入端或非门,使其输出为1的输入变量取值组合有()种。
A.15
B.8
C.7
D.1
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（103）随机存取存储器具有()功能。
A.读/写
B.无读/写
C.只读
D.只写
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（104）标准与-或表达式是由()构成的逻辑表达式。
A.与项相或
B.最小项相或
C.最大项相与
D.或项相与
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（105）设计一个模10计数器需要()个触发器。
A.3
B.4
C.6
D.10
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（106）4线-16线译码器有()个输出信号。
A.1
B.4
C.8
D.16
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（107）数字系统中,能实现精准定时的电路是()。
A.施密特触发器
B.单稳态触发器
C.多谐振荡器
D.集成定时器
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（108）
A.111
B.010
C.000
D.101
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（109）十六路数据选择器的地址输入(选择控制)端有()个。
A.16
B.2
C.4
D.8
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多选题：
（1）逻辑代数的基本规则是（ ）。
A.代入规则
B.反演规则
C.对偶规则
D.延展规则
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（2）逻辑函数的化简方法有（ ）。
A.并项法
B.吸收法
C.消去法
D.配项法
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（3）TTL电路在正逻辑系统中，以下各种输入中( )相当于输入逻辑“1”。
A.悬空
B.通过电阻2.7k接电源
C.通过电阻2.7k接地
D.通过电阻510接地
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（4）逻辑函数的表示方法中具有唯一性的是（ ）。
A.真值表
B.表达式
C.逻辑图
D.卡诺图
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（5）卡诺图化简画包围圈时应遵循的原则是（ ）。
A.包围圈内的方格数必定是2的n次方个，n等于1、2、3、…
B.相邻方格包括上下相邻、左右相邻和四角相邻
C.同一个方格可以被不同的包围圈重复包围，但新增包围圈中一定要有新的方格，否则该包围圈为多余
D.包围圈内的方格数要尽可能多，包围圈的数目尽可能少
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（6）目前使用的两种双极型数字集成电路是（）。
A.TTL
B.PLD
C.COMS
D.ECL
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（7）逻辑代数的基本规则是（）。
A.代入规则
B.反演规则
C.对偶规则
D.延展规则
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（8）时序逻辑电路可分为（）时序电路。
A.触发
B.定时
C.异步
D.同步
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（9）消除冒险竞争的方法（）。
A.发现并消去互补相乘项
B.增加乘积项避免互相项相加
C.输出端并联电容器
D.输入端并联电容器
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（10）在下列逻辑电路中，属于组合逻辑电路的有（）。
A.译码器
B.编码器
C.全加器
D.寄存器
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（11）下列触发器中，克服了空翻现象的有( )。
A.边沿D触发器
B.主从RS触发器
C.同步RS触发器
D.主从JK触发器
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（12）计数器按触发器动作分类，可分为（）。
A.加法计数器
B.减法计数器
C.同步计数器
D.异步计数器
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（13）卡诺图化简的步骤是（ ）。
A.将逻辑函数写成最小项表达式
B.按最小项表达式填写卡诺图
C.合并最小项
D.将包围圈对应的乘积项相加
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（14）卡诺图化简步骤是（ ）。
A.将逻辑函数写成最小项表达式
B.按最小项表达式填写卡诺图
C.合并最小项
D.将包围圈对于的乘积项相加
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（15）下列那种是描述时序电路逻辑功能的方法（）。
A.逻辑方程组
B.状态图
C.电路图
D.时序图
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（16）逻辑函数的化简方法有（）。
A.并项法
B.吸收法
C.消去法
D.配项法
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（17）数字集成电路按结构的不同形式，分为（ ）。
A.NOMS
B.PMOS
C.CMOS
D.NPMOS
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（18）逻辑变量的取值１和０可以表示（ ）。
A.开关的闭合、断开
B.电位的高、低
C.真与假
D.电流的有、无
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（19）TTL逻辑电路包括（）。
A.非门
B.与非门
C.或非门
D.与或非门
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（20）与十进制相比二进制的优点是（ ）。
A.数字装置简单可靠、所有元件少
B.运算规则简单、运算操作方便
C.运算速度快
D.数值表达清晰、便于观察
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（21）（ ）构成各种时序电路的存储单元电路。
A.寄存器
B.锁存器
C.触发器
D.定时器
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（22）下列哪一个是按照电路结构对触发器进行分类的（ ）。
A.基本RS触发器
B.T触发器
C.同步触发器
D.主从触发器
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（23）分析同步时序逻辑电路的一般步骤是（ ）。
A.列出逻辑方程组
B.列出状体表、画状态图或时序图
C.确定电路逻辑功能
D.列出时序逻辑电路功能
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（24）CMOS数字集成电路与TTL数字集成电路相比突出的优点是( )。
A.微功耗
B.高速度
C.高抗干扰能力
D.电源范围宽
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（25）构成移位寄存器可以采用的触发器为（ ）。
A.R-S型
B.J-K型
C.主从型
D.同步型
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（26）分析组合逻辑电路的步骤（）。
A.根据逻辑电路，从输入到输出写出各级逻辑表达式，直到写出最后输出端与输入信号的逻辑函数表达式
B.将各逻辑函数表达式化简和变换，以得到最简单的表达式
C.根据化简后逻辑表达式列出真值表
D.根据真值表和化简后的逻辑表达式对逻辑电路进行分析，最后确定其功能
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（27）有（）时序逻辑电路就被唯一地确定。
A.输出方程组
B.激励方程组
C.状态方程组
D.锁存方程组
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（28）设计同步时序逻辑电路的一般步骤包括（ ）和确定激励方程组、输出方程组、画出逻辑图、检查自启功能。
A.建立原始状态图和原始状态表
B.状态化简
C.状态分配
D.选择触发器类型
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（29）下列哪一个是按照电路结构对触发器进行分类的( )。
A.基本RS触发器
B.T触发器
C.同步触发器
D.主从触发器
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（30）下面代码中哪些是无权码( )。
A.8421BCD码
B.5421BCD码
C.余三码
D.格雷码
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（31）下列那种是描述时序电路逻辑功能的方法( )。
A.逻辑方程组
B.状态图
C.电路图
D.时序图
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（32）逻辑函数的表示方法中具有唯一性的是( )。
A.真值表
B.表达式
C.逻辑图
D.卡诺图
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（33）构成移位寄存器可以采用的触发器为( )。
A.R-S型
B.J-K型
C.主从型
D.同步型
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（34）欲使JK触发器按Qn+1=0工作,可使JK触发器的输入端( )。
A.J=K=1
B.J=Q,K=Q
C.J=Q,K=1
D.J=0,K=1
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判断题：
（1）任意一个逻辑函数经过变化，都能表示成唯一的最小项表达式。
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（2）0FEH是数制中的十六进制。
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（3）竞争现象肯定会产生干扰脉冲。
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（4）若两个函数具有不同的逻辑函数式，则两个逻辑函数必然不相等。
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（5）7的8421BCD码是0101。
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（6）门电路组成的多谐振荡器振荡周期与时间常数RC无关。
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（7）数字系统设计分为自下而上和自上而下的设计方法。
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（8）多谐振荡器的两个暂稳态转换过程是通过电容C充放电来完成的。
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（9）ASM图中有状态框、判断框、输出框三种符号。
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（10）电路的噪声容限越大，抗干扰能力愈强。
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（11）8421码1001比0001大。
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（12）模拟信号在时间上的连续变化的，幅值上也是连续取值的。
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（13）D码是用字母B、C、D、表示的代码。
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（14）计数器在数字电路中只能用于对脉冲进行计数。
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（15）4008为四位二进制超前进位全加器。
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（16）异或函数与同或函数在逻辑上互为反函数。
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（17）数字信号是一系列时间离散、数值也离散的信号。
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（18）十进制是以阿拉伯数字为基数的计数体制。
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（19）八进制数（18）8比十进制（18）10小。
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（20）用一个二进制代码表示特定含义的信息称为编码。
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（21）异或函数和同或函数在逻辑上互为反函数。
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（22）八进制数（18）8比十进制数（18）10小。
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（23）D码就是用字母B、C、D、表示的代码。
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（24）0FEH是我们数制中的十六进制。
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（25）数字信号就是一系列时间离散、数值也离散的信号。
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（26）电路的噪声容限越大，其抗干扰能力愈强。
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（27）一个双稳态触发器可以保存1位二值信息。
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（28）十进制就是以阿拉伯数字为基数的计数体制。
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（29）555定时器的仅用于信号的产生和变化。
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（30）真值表是将n个输入变量的2n个状态及其对应的输出函数列成一个表格（）
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（31）同一个逻辑函数可以有多种不同的表达式和逻辑图的表示法。（）
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（32）组合逻辑电路的特点是任意时刻电路的输出状态只取决于该时刻输入逻辑变量取值的组合。（）
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（33）译码是编码的逆过程, 即是将代码所表示的信息翻译过来的过程。（）
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（34）采用移位寄存器可以把一脉冲信号延迟8个Tcp后输出。（）
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（35）主从触发器中的主触发器和从触发器的时钟信号互补可以有效的克服空翻。（）
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（36）组合逻辑电路中的输出状态值决定于同一时刻的输入状态。（）
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（37）寄存器是计算机和其他数字系统中用来存储代码或数据的逻辑部件。（）
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（38）在组合逻辑电路中，输入和输出之间没有反馈延迟通路。（）
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（39）若一个逻辑函数由三个变量组成，则最小项共有4个。（）
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（40）时序逻辑电路中只含有门电路。（）
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（41）正逻辑是指高电平用“0”表示，低电平用“1”表示。（）
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（42）设计编码器和译码器的步骤都是：列真值表→画出逻辑电路图→写逻辑表达式。（）
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（43）全加器就是由两个半加器组成。（）
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（44）组合逻辑电路由触发器构成。（）
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（45）或门的多余输入端可与有用端并联或接高电平（）
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（46）门的品质因数M值越大,门的性能越好（）
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（47）时序电路具有记忆能力,能保存电路原来的输入状态（）
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（48）组合电路分析的结果是要获得电路的真值表（）
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（49）在环形振荡器中，在环形通道中串入RC环节可以降低震荡频率。（）
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（50）数据分配器是一种单输入．多输出的组合逻辑电路，它将一路输入变为多路输出。（）
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（51）真值表是将n个输入变量的2n个状态及其对应的输出函数列成一个表格（）
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（52）逻辑函数的最简并不等于逻辑电路最简。（）
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（53）编码器是对输入信号进行编码, 输出的是用若干个0和1按一定规律排列的代码。（）
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（54）译码是编码的逆过程, 即是将代码所表示的信息翻译过来的过程。（）
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（55）采用移位寄存器可以把一脉冲信号延迟8个Tcp后输出。（）
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（56）74LS138有8个译码输入端和3个译码输出端。（）
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（57）寄存器是计算机和其他数字系统中用来存储代码或数据的逻辑部件。（）
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（58）全面描述一个时序电路的功能，必须使用三个方程式，缺一不可。（）
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（59）在组合逻辑电路中，输入和输出之间没有反馈延迟通路。（）
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（60）时序逻辑电路中只含有门电路。（）
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（61）正逻辑是指高电平用“0”表示，低电平用“1”表示。（）
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（62）设计编码器和译码器的步骤都是：列真值表→画出逻辑电路图→写逻辑表达式。（）
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（63）时序电路具有记忆能力,能保存电路原来的输入状态（）
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（64）组合电路分析的结果是要获得电路的真值表（）
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（65）在寄存器中，一个触发器只能储存1位二进制代码。（）
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（66）数据分配器是一种单输入．多输出的组合逻辑电路，它将一路输入变为多路输出。（）
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（67）用74LS138译码器实现多输出逻辑函数，需要增加若干个与非门。（）
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（68）同一个逻辑门电路，如果在正逻辑定义下实现"与非"功能，那么，在负逻辑定义下可以实现"或非"功能。（）
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（69）八进制数(18)8比十进制数(18)10小。
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（70）8421码1001比0001大。
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（71）当8421奇校验码在传送十进制数(8)10时,在校验位上出现了1时,表明在传送过程中出现了错误。
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（72）AB=AC 则 B=C
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（73）二极管的外加电压小于0.5V时管子截止,相当于断开的开关。
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（74）NMOS管当管子截止,相当于断开的开关。
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（75）74LS148为10-4线优先编码器。
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（76）从电路结构上看,时序电路必须含有门电路。
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（77）BCD码就是用字母B、C、D表示的代码。
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（78）CC4008为四位二进制超前进位全加器。
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（79）二极管与门中,当输入端悬空时,输出为高电平
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（80）CMOS门电路闲置输入端不允许悬空。
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（81）若ABC=ADC则B=D。( )
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（82）已知逻辑式AB+B=AC+C,则B=C。( )
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（83）正逻辑体制下,由三个开关并联起来控制一只电灯时,电灯的亮与不亮同三个开关的闭合或断开之间的对应关系属于“与”的逻辑关系。( )
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（84）逻辑代数式L1 =(A+B)C,L2 =A(B+C),则L1 = L2?。( )
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（85）数字电路中的高电平.低电平都是指一定的电压范围,而并非某一固定值。( )
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（86）基本RS触发器无翻转功能。( )
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（87）同一个逻辑函数可以有多种不同的表达式和逻辑图的表示法。()
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（88）组合逻辑电路的特点是任意时刻电路的输出状态只取决于该时刻输入逻辑变量取值的组合。()
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（89）逻辑函数的最简并不等于逻辑电路最简。()
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（90）编码器是对输入信号进行编码, 输出的是用若干个0和1按一定规律排列的代码。()
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（91）采用移位寄存器可以把一脉冲信号延迟8个Tcp后输出。()
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（92）计数器仅用于输入时钟脉冲的个数。()
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（93）74LS138有8个译码输入端和3个译码输出端。()
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（94）n位扭环寄存器可以构成n进制计数器。()
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（95）全面描述一个时序电路的功能,必须使用三个方程式,缺一不可。()
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（96）若一个逻辑函数由三个变量组成,则最小项共有4个。()
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（97）组合逻辑电路由触发器构成。()
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（98）或门的多余输入端可与有用端并联或接高电平()
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（99）门的品质因数M值越大,门的性能越好()
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（100）时序电路具有记忆能力,能保存电路原来的输入状态()
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（101）组合电路分析的结果是要获得电路的真值表()
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（102）在寄存器中,一个触发器只能储存1位二进制代码。()
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（103）在环形振荡器中,在环形通道中串入RC环节可以降低震荡频率。()
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（104）用74LS138译码器实现多输出逻辑函数,需要增加若干个与非门。()
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作图题：
（104）用74LS138译码器实现多输出逻辑函数,需要增加若干个与非门。()
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（104）用74LS138译码器实现多输出逻辑函数,需要增加若干个与非门。()
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（104）用74LS138译码器实现多输出逻辑函数,需要增加若干个与非门。()
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（104）用74LS138译码器实现多输出逻辑函数,需要增加若干个与非门。()
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（104）用74LS138译码器实现多输出逻辑函数,需要增加若干个与非门。()
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（104）用74LS138译码器实现多输出逻辑函数,需要增加若干个与非门。()
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计算题：
（1）用最少的D触发器和与非门，设计一个同步四进制增量计数器（按自然态序变化），写出设计过程，画出逻辑图。
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（2）试用3线—8线译码器74LS138和门电路实现下列函数。 Z（A、B、C）=AB+C
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（3）如下图所示维持阻塞D触发器，设初态为0,根据CP脉冲及A输入波形画出Q波形。
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（4）在输入端只给出原变量没有反变量的条件下，用与非门设计实现下列函数的组合电路：F(A、B、C、D)=∑(1，5，6，7，12，13，14)
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（5）将下列函数化简为最简与或表达式 （1） （2）0F 2 （ A,B,C,D）=∑m (0,1,2,4,5,9)+∑d (7,8,10,11,12,13)
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（6）试用74138译码器(如图所示)和少量门电路实现逻辑函数：P1=(AB)C+; P2=AB+AC+BC。输入变量A，B，C分别接74138译码器的输入端A2，A1和A0。
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（7）试用74138译码器(如图所示)和少量门电路实现逻辑函数：P1=(AB)C+; P2=AB+AC+BC。输入变量A，B，C分别接74138译码器的输入端A2，A1和A0。
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（8）某机床共有4个电气开关(断为0，通为1)，每一开关控制一个机器动作，生产某零件需8道工序，每道工序的开关通断列表(见图)，用组合逻辑电路实现，要求写出K2的方程。
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（9）试分析图示时序逻辑电路,写出驱动方程、状态方程和输出方程.画出当X=l时的状态图，并说明此时该电路的功能.设触发器的初态为00。
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（10）在输入端只给出原变量没有反变量的条件下，用与非门设计实现下列函数的组合电路：F(A、B、C、D)=
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（11）试用3线—8线译码器74LS138和门电路实现下列函数。 Z（A、B、C）=AB+C
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（12）如下图所示维持阻塞D触发器，设初态为0,根据CP脉冲及A输入波形画出Q波形。
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（13）在输入端只给出原变量没有反变量的条件下，用与非门设计实现下列函数的组合电路：F(A、B、C、D)=∑(1，5，6，7，12，13，14)
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（14）将下列函数化简为最简与或表达式 （1） （2）0F 2 （ A,B,C,D）=∑m (0,1,2,4,5,9)+∑d (7,8,10,11,12,13)
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（15）试用74138译码器(如图所示)和少量门电路实现逻辑函数：P1=(AB)C+; P2=AB+AC+BC。输入变量A，B，C分别接74138译码器的输入端A2，A1和A0。
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分析题：
（15）试用74138译码器(如图所示)和少量门电路实现逻辑函数：P1=(AB)C+; P2=AB+AC+BC。输入变量A，B，C分别接74138译码器的输入端A2，A1和A0。
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（15）试用74138译码器(如图所示)和少量门电路实现逻辑函数：P1=(AB)C+; P2=AB+AC+BC。输入变量A，B，C分别接74138译码器的输入端A2，A1和A0。
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（15）试用74138译码器(如图所示)和少量门电路实现逻辑函数：P1=(AB)C+; P2=AB+AC+BC。输入变量A，B，C分别接74138译码器的输入端A2，A1和A0。
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（15）试用74138译码器(如图所示)和少量门电路实现逻辑函数：P1=(AB)C+; P2=AB+AC+BC。输入变量A，B，C分别接74138译码器的输入端A2，A1和A0。
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（15）试用74138译码器(如图所示)和少量门电路实现逻辑函数：P1=(AB)C+; P2=AB+AC+BC。输入变量A，B，C分别接74138译码器的输入端A2，A1和A0。
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（15）试用74138译码器(如图所示)和少量门电路实现逻辑函数：P1=(AB)C+; P2=AB+AC+BC。输入变量A，B，C分别接74138译码器的输入端A2，A1和A0。
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（15）试用74138译码器(如图所示)和少量门电路实现逻辑函数：P1=(AB)C+; P2=AB+AC+BC。输入变量A，B，C分别接74138译码器的输入端A2，A1和A0。
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（15）试用74138译码器(如图所示)和少量门电路实现逻辑函数：P1=(AB)C+; P2=AB+AC+BC。输入变量A，B，C分别接74138译码器的输入端A2，A1和A0。
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（15）试用74138译码器(如图所示)和少量门电路实现逻辑函数：P1=(AB)C+; P2=AB+AC+BC。输入变量A，B，C分别接74138译码器的输入端A2，A1和A0。
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（15）试用74138译码器(如图所示)和少量门电路实现逻辑函数：P1=(AB)C+; P2=AB+AC+BC。输入变量A，B，C分别接74138译码器的输入端A2，A1和A0。
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设计题：
（15）试用74138译码器(如图所示)和少量门电路实现逻辑函数：P1=(AB)C+; P2=AB+AC+BC。输入变量A，B，C分别接74138译码器的输入端A2，A1和A0。
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（15）试用74138译码器(如图所示)和少量门电路实现逻辑函数：P1=(AB)C+; P2=AB+AC+BC。输入变量A，B，C分别接74138译码器的输入端A2，A1和A0。
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（15）试用74138译码器(如图所示)和少量门电路实现逻辑函数：P1=(AB)C+; P2=AB+AC+BC。输入变量A，B，C分别接74138译码器的输入端A2，A1和A0。
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（15）试用74138译码器(如图所示)和少量门电路实现逻辑函数：P1=(AB)C+; P2=AB+AC+BC。输入变量A，B，C分别接74138译码器的输入端A2，A1和A0。
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