超前自学网【期末高分题集】[东北师范大学]《数字电路与数字逻辑》考核必备34
奥鹏期末考核
50080–《数字电路与数字逻辑》2022年东北师范大学期末复习题集
单选题：
（1）在布尔逻辑中，每个逻辑变量的取值只有（）种可能。
A.1
B.2
C.3
D.4
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（2）电路具有两个稳定状态，在无外来触发信号作用时，电路将()。
A.自动变化
B.保持原状态不变
C.不确定
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（3）用二进制码表示指定离散电平的过程称为（）
A.采样
B.量化
C.保持
D.编码
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（4）一个容量为512*1的静态RAM具有()
A.地址线9根,数据线1根
B.地址线1根,数据线9根
C.地址线512根,数据线9根
D.地址线9根,数据线512根
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（5）随机存储器RAM中的内容,当电源断掉后又接通,存储器中的内容()
A.全部改变
B.全部为0
C.不可预料
D.保持不变
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（6）PLA的中文全称是（）
A.通用阵列逻辑
B.现场可编程门阵列
C.可编程逻辑阵列
D.可编程阵列逻辑
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（7）计数器是用来累计()的逻辑部件。
A.运算结果
B.运算步骤
C.脉冲数目
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（8）将二进制数11001.01转换为十进制数是：（）
A.20.25
B.25.25
C.25.20
D.25.10
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（9）PAL的中文全称是（）
A.通用阵列逻辑
B.现场可编程门阵列
C.可编程逻辑阵列
D.可编程阵列逻辑
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（10）余3码01101001.01110011转换为十进制数是：()
A.28.36
B.36.40
C.79.31
D.34.66
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（11）将二进制数1011110.0100101转换为十六进制数是：()
A.5E.45
B.C5.61
C.53.F5
D.7B.45
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（12）逻辑表达式通过逻辑变量、常量、()来描述逻辑函数的因果关系
A.逻辑运算
B.程序
C.符号
D.伪代码
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（13）组合电路是由（）。
A.门电路构成
B.触发器构成
C.A和B
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（14）使用 D/A 转换器再配以相应的程序，可以产生锯齿波，该锯齿波的()
A.斜率是可调的
B.幅度是可调的
C.极性是可变的
D.回程斜率只能是垂直的
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（15）一个无符号10位数字输入的DAC，其输出电平的级数为( )
A.4
B.10
C.1024
D.2^10
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（16）一般门电路的为1—5，最多不超过()。
A.6
B.7
C.8
D.9
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（17）ISP工程KIT是基于（）编程接口实现的
A.PC串行I/O
B.PC并行I/O
C.端口号
D.存储器地址
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（18）对于逻辑函数中的逻辑变量，常作为逻辑推理的输入，当输入的逻辑变量确定后，作为输出的逻辑函数F()。
A.惟一地确定了
B.不确定
C.确定但是不唯一
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（19）逻辑代数的化简法主要有两种——公式化简法和()化简法。
A.卡诺图
B.ERA图
C.矩阵
D.算术
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（20）数字电路中使用的数制是（）。
A.二进制
B.八进制
C.十六进制
D.十进制
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（21）将十六进制数9DA转换为二进制数是：()
A.100111011010
B.111001110000
C.101010000111
D.111010101111
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（22）寄存器是用来暂存数据的()部件。
A.物理
B.物理和逻辑
C.逻辑
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（23）在外加触发信号有效时，电路可以触发翻转，实现()。
A.置0
B.置1
C.置0或置1
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（24）以下四种转换器，()是A/D转换器且转换速度最高
A.并联比较型
B.逐次逼近型
C.双积分型
D.施密特触发器
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（25）将十六进制数E3.14B转换为二进制数是：()
A.10011110.001011100010
B.11000111.010101111100
C.11100011.000101001011
D.11101010.110010110101
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（26）只读存储器具有（）功能
A.读/写
B.无读/写
C.只读
D.只写
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（27）将十进制数456.6875转换为二进制数是：()
A.111001000.1011
B.110001001.1011
C.100110111.0011
D.110011010.1101
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（28）下列哪个不是进程语句的组成部分（）
A.敏感表
B.进程
C.结束
D.实体
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（29）下列不属于PLD编程连接点的形式是（）
A.固定连接
B.编程连接
C.不固定连接
D.不连接
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（30）在数字电路中，用来存放二进制数据或代码的电路称为().
A.寄存器
B.转发器
C.存储器
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（31）8位移位寄存器，串行输入时经（）个脉冲后，8位数码全部移入寄存器中
A.1
B.2
C.4
D.8
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（32）555定时器不可以组成( )
A.多谐振荡器
B.单稳态触发器
C.施密特触发器
D.JK触发器
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（33）FPGA的中文全称是（）
A.通用阵列逻辑
B.现场可编程门阵列
C.可编程逻辑阵列
D.可编程阵列逻辑
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（34）()中的数据可以在移位脉冲作用下依次逐位右移或左移，数据既可以并行输入、并行输出，也可以串行输入、串行输出，还可以并行输入、串行输出，串行输入、并行输出，十分灵活，用途也很广。
A.移位寄存器
B.寄存器
C.存储器
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（35）将二进制数1110111.0110101转换为十六进制数是：()
A.71.F1
B.73.6E
C.80.F1
D.77.6A
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（36）同步时序电路和异步时序电路比较,其差异在于后者()。
A.没有触发器
B.没有统一的时钟脉冲控制
C.没有稳定状态
D.输出只与内部状态有关
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（37）而异步计数器中各触发器的触发脉冲不尽相同，所以触发器的状态是否翻转除了考虑其驱动方程外，还必须考虑其()是否出现。
A.时钟输入端的触发脉冲
B.时钟输出端的触发脉冲
C.时钟输入端的触发脉冲和时钟输出端的触发脉冲
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（38）多余输入端可以悬空使用的门是（）。
A.与非门
B.TTL与非门
C.或非门
D.亦或门
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（39）双稳态触发器可以作为()存储单元使用。
A.十进制
B.二进制
C.十六进制
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（40）PLSI器件的实现功能的核心部分是（）
A.通用逻辑块（GLB）
B.总体布线池（GRP）
C.输出布线池（ORP）
D.输入输出单元
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（41）一位8421BCD码计数器至少需要()个触发器
A.3
B.4
C.5
D.10
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（42）八进制数1452转换为二进制数是：()
A.001100101010
B.110001110001
C.110011000101
D.110010110101
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（43）逻辑代数由逻辑变量集、逻辑常量及其()构成.
A.逻辑运算
B.程序
C.符号
D.伪代码
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（44）译码电路的输出量是（）。
A.二进制代码
B.十进制代码
C.某个特定的控制信息
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（45）所谓对偶规则，是指当某个逻辑恒等式成立时，则其对偶式()。
A.不成立
B.可能成立
C.不确定
D.成立
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（46）ispEXPERT设计输入不可采用（）
A.原理图
B.硬件描述语言
C.功能模拟
D.混合输入
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（47）0 和 1 称为逻辑常量，它表示()的逻辑状态。
A.数量的大小
B.两种对立
C.两种一致
D.没有意义
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（48）触发器的次态不仅与输入信号状态有关，而且与()有关。
A.触发器原来的状态
B.输出信号状态
C.触发器目前状态
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（49）施密特触发器有（）
A.两个稳态
B.一个稳态，两个暂稳态
C.一个稳态，一个暂稳态
D.两个暂稳态
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（50）为了记忆电路的状态，时序电路必须包含有()。
A.存储电路
B.寄存器
C.存储器
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（51）将十进制数51.625转换为二进制数是：()
A.100111.001
B.110001.001
C.100110.101
D.110011.101
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（52）组合逻辑电路的输出和（）的状态有关。
A.输出
B.输入
C.输入和输出
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（53）八输入端的编码器按二进制数编码时，输出端的个数（）。
A.1
B.2
C.3
D.4
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（54）一个两输入端的门电路，当输入为1或0时，输出不是1的门为（）。
A.与非门
B.或门
C.或非门
D.亦或门
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（55）如果输入变量有n个，则组合有()种输入组合。
A.n
B.2n
C.n/2
D.2的n次幂
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（56）下列不属于简单PLD的是（）
A.PLA
B.PAL
C.GAL
D.CPLD
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（57）在使用多片 DAC0832 进行 D/A 转换，并分别输入数据的应用中，它的两极数据锁存结构可以（）
A.保证各模拟电压能同时输出
B.提高D/A转换速度
C.提高D/A 转换速度
D.增加可靠性
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（58）多谐振荡器有（）
A.两个稳态
B.一个稳态，两个暂稳态
C.一个稳态，一个暂稳态
D.两个暂稳态
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（59）一个容量为1K*8的存储器有（）个存储单元
A.8
B.8K#8000
C.8192
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（60）时序逻辑电路必不可少的部分是()
A.存储电路
B.组合电路#内部电路
C.输入端
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（61）将一个时间上连续变化的模拟量转换为时间上断续(离散)的模拟量的过程称为()
A.采样
B.量化
C.保持
D.编码
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（62）要构成容量为4K*8的RAM，需要（）片容量为256*4的RAM
A.2
B.4
C.8
D.32
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多选题：
（1）具有以下（）逻辑功能的触发器为T触发器。
A.当控制信号T=1时每来一个CP信号它的状态就翻转一次
B.当T=0时，触发器的状态保持不变
C.当控制信号T=0时每来一个CP信号它的状态就翻转一次
D.当T=1时，触发器的状态保持不变
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（2）选取化简后的乘积项。选取的原则是（）。
A.这些乘积项应包含逻辑式中所有的最小项(应复盖卡诺图中所有的1)。
B.所用的乘积项数目最少。也就是可合并的最小项组成的矩形组数目最少。
C.每个乘积项包含的因子最少。也就是每个可合并的最小项矩形组中应包含尽量多的最小项。
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（3）基本RS触发器的S和R叫做直接置位端和直接复位端，这种触发器（）。
A.可以用来存储信息
B.不能用做计数
C.不可以用来存储信息
D.能用做计数。
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（4）为了消除电平异步时序电路中反馈回路间的临界竞争，状态编码时通常采用 ( )的方法。
A.相邻状态，相邻分配
B.次态相同，现态相邻
C.增加过渡状态
D.输出相同，现态相邻
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（5）PLS2000与3000系列中基本逻辑单元与P奥鹏期末考核LS1000系列不同之处是（）
A.全局时钟结构
B.I/O单元
C.输出使能结构
D.输出布线池结构
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（6）用户使用PC并行口作编程的I/O口时（）
A.必须用附加电路将串行数据转换为正确的编程信号
B.必须用附加电路将并行数据转换为正确的编程信号
C.同时必须存在定时电路将串行指令转换成定时的ISP编程信号
D.同时必须存在定时电路将并行指令转换成定时的ISP编程信号
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（7）二元常量1、0分别表示（）电位。
A.高
B.低
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（8）进程语句的组成部分有（）
A.敏感表
B.进程
C.结束
D.实体
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（9）通常不能实现线与功能的门电路是（）。
A.OC门
B.TSL门
C.TTL与门
D.74LS与门
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（10）TTL电路的输出级是由构成的“推拉式”电路。
A.三极管
B.二极管
C.电阻
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（11）逻辑代数有一系列的定律和规则，用它们对逻辑表达式进行处理，可以完成对电路的()。
A.化简
B.变换
C.分析
D.设计
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（12）下列电路中，属于组合逻辑电路的是（）。
A.编码器
B.译码器
C.数据选择器
D.计数器
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（13）米里型时序电路的输出()
A.与输入有关
B.与输入无关
C.与当前状态无关
D.与当前状态有关
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（14）（）这种存储元件就是触发器。
A.可由输入预置为新状态
B.能稳定地保持下去，直到再受输入的作用
C.不可由输入预置为新状态
D.不能稳定地保持下去，直到再受输入的作用。
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（15）二进制是计算机运算的基础，它只有两个符号（）。
A.0
B.1
C.2
D.4
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（16）关于函数最大项描述正确的是（）。
A.在输入变量任意值下必有一个，且仅有一个最大项的值等于0
B.任意两个最大项的和等于0
C.全体最大项的乘积等于1
D.全体最大项的乘积等于0
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（17）动态MOS RAM的优点是（）
A.单元电路结构简单
B.单片集成度高
C.功耗比静态MOS RAM低
D.不需要刷新和再生操作
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（18）下列哪些特殊二进制码常用来表示十进制数（）。
A.8421码
B.2421码
C.余3码
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（19）脉冲异步时序逻辑电路中的存储元件可以采用（ ）。
A.时钟控制RS触发器
B.D触发器
C.基本RS触发器
D.JK触发器
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（20）寄存器按照功能不同,可分为以下哪两类()
A.计数器
B.基本寄存器
C.移位寄存器
D.数码寄存器
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（21）下列哪些电路属于组合逻辑电路（）。
A.编码器
B.译码器
C.数据选择器
D.数值比较器
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（22）在使用同步RS触发器的过程中，有时需要在CP信号到来之前预先将触发器置成指定状态，故而在实用的同步RS触发器电路上还往往设置了专门的（）。
A.置位端
B.复位端
C.输出端
D.输入端
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（23）逻辑代数由()构成。
A.逻辑变量集
B.逻辑常量
C.逻辑运算
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（24）在数字电路中，存在哪几种类型的电路()
A.存储电路
B.时序逻辑电路
C.内部电路
D.组合逻辑电路
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（25）（）的权存在着2的幂次关系。
A.二进制
B.八进制
C.十六进制
D.十进制
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（26）PLD编程连接点有哪几种形式()
A.固定连接
B.不固定连接
C.编程连接
D.不连接
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（27）RAM具有哪些优点（）
A.成本低
B.功耗小
C.适用于大容量数据存储
D.可以计数
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（28）应用逻辑门电路设计组合电路的步骤大致是：（）。
A.列出真值表
B.写出逻辑表达式（或填写卡诺图）
C.逻辑化简和变换
D.画出逻辑图
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（29）单稳态触发器具有()功能
A.定时
B.延时
C.整形
D.译码
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（30）当温度升高时，二极管的反向饱和电流将：（）。
A.增大
B.不变
C.减小
D.改变
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（31）各种触发器在具体的逻辑功能上又有所差别。这些逻辑功能可以用（）描述。
A.特性表
B.特性方程
C.状态转换图
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（32）下列哪些属于直接型ADC（）
A.逐次逼近型ADC
B.单积分型ADC
C.双积分型ADC
D.并联方式ADC
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（33）TTL与门电路，多余输入端可接（）。
A.VCC
B.与有信号输入端并联
C.悬空
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（34）DAC的主要技术指标是（）
A.分辨率
B.转换精度
C.转换速度
D.量化误差
E.线性度
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（35）将模拟信号转换为数字信号，需要经过哪几个过程（）
A.采样
B.量化
C.保持
D.编码
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（36）下列哪些属于时序逻辑电路()
A.计数器
B.寄存器
C.移位寄存器
D.译码器
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（37）十六进制符号有：（）。
A.A
B.D
C.E
D.M
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（38）ADC的主要技术指标是（）
A.分辨率
B.转换精度
C.偏移误差
D.量化误差
E.线性度
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（39）下列哪些属于逻辑运算（）。
A.加
B.与
C.或
D.非
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（40）最大项具有下列性质：（）。
A.在输入变量的任何取值下必有一个最大项，而且仅有一个最大项的值为0。
B.任意两个最大项之和为1。
C.全体最大项之积为0。
D.只有一个变量不同的两个最大项的乘积等于各相同变量之和
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（41）公式化简法的实质就是反复使用逻辑代数的基本公式和常用公式消去多余的（），以求得逻辑式的最简形式。
A.乘积项
B.每个乘积项中多余的因子
C.任何项中的多余因子
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（42）FPGA采用了逻辑单元阵列,内部包括()部分
A.配置逻辑模块CLB
B.输出输入模块IOB
C.输出逻辑宏单元
D.内部连线
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（43）施密特触发器的特点是（）
A.有两个稳定状态
B.有一个稳定状态
C.电路状态的翻转是用电位触发
D.电路状态的翻转是用信号触发
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（44）T型网络D/A转换器电路由（）组成
A.T型电阻解码网络
B.模拟电子开关
C.求和放大器
D.移位寄存器
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（45）单稳态电路有下列特点（）
A.只有一个稳定状态，另一个是暂稳态
B.有二个稳定状态
C.在触发信号作用下，可从稳态进入暂稳态
D.在触发信号作用下，可从暂稳态进入稳态
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（46）最常用的两种整形电路是（）。
A.R—S触发器
B.施密特触发器
C.J—K触发器
D.单稳态触发器
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（47）下列哪个芯片是不异或门（）。
A.74LS00
B.74LS 04
C.74LS74
D.74LS86
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（48）按照逻辑功能的不同特点，通常将时钟控制的触发器分为()等几种类型。
A.RS触发器
B.JK触发器
C.T触发器
D.D触发器
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（49）所谓几何相邻，是指卡诺图上邻接的任意两个小方格所代表的两个最小项中，仅有一个变量互为反变量，其余变量均相同。这种相邻关系既可是()。
A.上下相邻
B.左右相邻
C.首尾相邻
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（50）TTL TS门（三态电路）的三种可能的输出状态是()。
A.高电平
B.低电平
C.高阻
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（51）使用和存储二进制数的格式：（）。
A.无符号数
B.有符号数
C.二进制数
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（52）基本RS触发器用两个输入端分别加有效信号（在这里低电平有效）可使触发器直接（）。
A.置0
B.置1
C.置-1
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（53）下列属于与阵列可编程，或阵列固定的GAL有()
A.GAL16V7
B.GAL20V7
C.ispGAL16Z7
D.GAL39V17
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（54）单稳态触发器的工作过程可分下列三个阶段来分析
A.出发翻转阶段
B.暂稳维持状态
C.返回恢复阶段
D.中断维持
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（55）静态MOS RAM的优点是（）
A.不需要刷新操作
B.不需要再生操作
C.价格比动态MOS RAM低
D.价格比动态MOS RAM高
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（56）FLEX/ACEX的结构主要包括（）
A.LAB
B.I/O块
C.RAM块
D.可编程行/列连线
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（57）ROM的一般结构由（）组成
A.地址译码器
B.指令译码器
C.存储矩阵
D.读出电路
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（58）555定时器电路可以应用于哪些方面（）
A.自动控制
B.定时
C.仿声
D.防盗报警
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（59）ROM的一般结构由哪几部分组成（）
A.地址译码器
B.指令译码器
C.存储矩阵
D.读出电路
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（60）时序逻辑电路按照其触发器是否有统一的时钟控制分为()
A.Mealy型
B.Moore型
C.同步时序逻辑电路
D.异步时序逻辑电路
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（61）双积分型ADC电路由（）组成
A.反向比例积分器
B.电压比较器
C.脉冲发生器
D.控制电路
E.移位寄存器
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（62）555定时器由哪几部分组成()
A.电阻分压器
B.电压比较器
C.基本R-S触发器
D.放电三极管
E.输出缓冲器
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（63）通用阵列逻辑GAL是（）
A.可用电擦除的
B.可重复编程的高速PLD
C.具有加密的功能
D.不可重复编程的高速PLD
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判断题：
（1）施密特触发器的正向阈值电压一定大于负向阈值电压。
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（2）把一个5进制计数器与一个10进制计数器串联可得到15进制计数器。
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（3）将二进制数1101101110转换为十六进制数是36E。
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（4）由两个TTL或非门构成的基本RS触发器,当R=S=0时,触发器的状态为不定
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（5）任一输入为0，其他输入为1输入情况下，“或非”运算的结果是逻辑0。
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（6）逻辑函数两次求反则还原，逻辑函数的对偶式再作对偶变换也还原为它本身。
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（7）余三码为无权码。
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（8）采用不可重触发单稳态触发器时，若在触发器进入暂稳态期间再次受到触发，输出脉宽可在此前暂稳态时间的基础上再展宽tW。
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（9）D触发器的特征方程Q^(n+1)=D，而与Q^n无关，所以，D触发器不是时序电路
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（10）利用反馈归零法获得N进制计数器时，若为异步置零方式，则状态SN只是短暂的过渡状态，不能稳定而是立刻变为0状态
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（11）通常用非线性误差的大小表示DAC的线性度。一般把理想的输入、输出特性的偏差与满刻度（FSR）输出之比的百分数定义为非线性误差
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（12）多谐振荡器常用作脉冲信号源及时序电路中的时钟信号
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（13）按照触发器的动作特点将时序逻辑电路分为Mealy型和Moore型
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（14）若两个函数具有相同的真值表，则两个逻辑函数必然相等。
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（15）采样是对连续变化的模拟信号进行周期性的测量，通常采样频率越高测量点越少，转换精度也越高
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（16）555定时器电路是一种双极型中规模集成电路
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（17）“溢出”一般是指计算机在运算过程中产生的数超过了机器的位的表示的范围。
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（18）ispEXPERT是一套完整的EDA设计软件
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（19）通用逻辑块是PLSI器件的实现功能的核心部分
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（20）在同步时序电路的设计中，若最简状态表中的状态数为2N，而又是用N级触发器来实现其电路，则不需检查电路的自启动性。
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（21）方波的占空比为0.5。
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（22）同步计数器和异步计数器比较，同步计数器的显著优点是工作速度高
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（23）数字电路中用“1”和“0”分别表示两种状态,二者无大小之分。
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（24）计算机中的所有信息均以二进制形式表示，但有时为了书写与阅读的方便，也使用八进制，十六进制 。
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（25）异步时序电路的各级触发器类型不同
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（26）对于74LS273只有清除端CLR为高电平时，具有锁存功能
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（27）寄存器分为基本寄存器和移位寄存器两大类
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（28）数据选择器与数据分配器中地址控制的作用是相同的。
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（29）计数器的模是指对输入的计数脉冲的个数。
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（30）在时间和幅度上都断续变化的信号是数字信号，语音信号不是数字信号。
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（31）PLD器件的逻辑功能描述一般分为原理图描述和硬件描述语言描述
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（32）今天PLD器件，能够完成任何数字器件的功能
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（33）组合电路不含有记忆功能的器件。
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（34）液晶显示器可以在完全黑暗的工作环境中使用。
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（35）编码与译码是互逆的过程。
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（36）计数器的模是指构成计数器的触发器的个数。
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（37）环形计数器如果不作自启动修改，则总有孤立状态存在
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（38）进程用于描述顺序事件并且包含在结构体中，通常一个结构体只可包含一个进程语句
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（39）在时序逻辑电路中，任一时刻的输出信号不仅和当时的输入信号有关，而且还与原来的状有关
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（40）异或函数与同或函数在逻辑上互为反函数。
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（41）与动态RAM比，静态RAM具有成本低、功耗小的优点，适用于大容量数据存储
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（42）在PLS2000与3000系列中基本逻辑单元与LS1000系列完全相同，只是在全局时钟结构、I/O单元、输出使能结构输出布线池结构上有所不同
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（43）数据选择器和数据分配器的功能正好相反，互为逆过程。
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（44）RAM中的信息,当电源断掉后又接通,则原存的信息不会改变
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（45）将十进制数25.3125转换成相应的十六进制数是19.4。
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（46）施密特触发器可用于将三角波变换成正弦波。
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（47）占空比的公式为：q = t w / T，则周期T越大占空比q越小。
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（48）从逻辑关系来看ROM的结构，它是由与门阵列和或门阵列构成的组合逻辑电路
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（49）动态随机存取存储器不需要刷新操作和再生操作
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（50）石英晶体多谐振荡器的振荡频率与电路中的R、C成正比。
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（51）若两个函数具有不同的真值表，则两个逻辑函数必然不相等。
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（52）矩形脉冲信号的参数有周期，占空比，脉宽。
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（53）RAM能随时读出RAM中所存的内容，又能随时将新的内容写入RAM中
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（54）数模转换器是能够把数字信号转换为模拟信号的器件
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（55）8421BCD码，2421BCD码为恒权码。
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（56）逻辑变量的取值，１比０大。
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（57）与模拟电路相比，数字电路主要的优点有通用性强，保密性好，抗干扰能力强。
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（58）实际中,常以字数和位数的乘积表示存储容量
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（59）同步时序电路具有统一的时钟CP控制。
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（60）同步时序电路由组合电路和存储器两部分组成
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（61）ispEXPERT能进行逻辑优化，将逻辑映射到器件中去，但不能自动完成布局与布线并生成编程所需要的熔丝图文件
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（62）在数字电路中，只存在时序逻辑电路
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（63）因为逻辑表达式A + B +AB=A+B+AB成立，所以A + B= A+B成立。
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（64）只读存储器是一种只能读出，不能写入的存储器
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（65）求一个逻辑函数F的对偶式，可将F中的原变量换成反变量，反变量换成原变量。
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（66）十进制数（9）10比十六进制数（9）16小。
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（67）将八进制数5674对应的二进制数是101110111100。
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（68）DAC芯片与微处理器实现单缓冲方式的接口电路，在单缓冲方式中，转换与输出要求同步
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（69）把十进制数193转换成相应的八进制数是301。
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（70）优先编码器的编码信号是相互排斥的，不允许多个编码信号同时有效。
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（71）动态随机存取存储器需要不断地刷新,以防止电容上存储的信息丢失
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（72）无论是那一种ADC，都是要把连续的模拟量转换成离散的数字量
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（73）施密特触发器有两个稳态
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（74）把二进制数100110转换成相应的十进制数是38。
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（75）A+BC=（A+B）（A+C）。
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（76）同步二进制计数器的电路比异步二进制计数器复杂，所以实际应用中较少使用同步二进制计数器
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（77）ADC0801~0805芯片具有三态输出锁存器，可以直接驱动数据总线，因此可与微处理器进行接口并且非常简单
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（78）在一个无符号二进制整数的右边填上一个0，新形成的数是原数的2倍。
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（79）将十进制数的整数化为N进制整数的方法是乘N 取余法。
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（80）将模拟量转换为数字量的装置称为A/D转换器
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（81）时序电路不含有记忆功能的器件。
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（82）组合逻辑电路中产生竞争冒险的主要原因是输入信号受到尖峰干扰。
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（83）液晶显示器的优点是功耗极小、工作电压低。
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（84）共阴接法发光二极管数码显示器需选用有效输出为高电平的七段显示译码器来驱动。
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（85）组合逻辑电路任意时刻的稳态输出，与输入信号作用前电路原来状态有关。
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（86）用数据选择器可实现时序逻辑电路。
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（87）单稳态触发器的暂稳态维持时间用tW表示，与电路中RC成正比。
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（88）余三循环码具有任何相邻码只有一位状态不同的特性。
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（89）VHDL常用语句分并行(Concurrent)语句和顺序(Sequential)语句两种
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（90）FPGA是作为专用集成电路（ASIC）领域中的一种半定制电路而出现的，既解决了定制电路的不足，又克服了原有可编程器件门电路数有限的缺点。
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（91）实体(Entity)类似于原理图中的符号(Symbol), 它描述模块的具体功能
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（92）异步时序逻辑电路其存储电路中的触发器状态的变化不是在同一时钟下进行的，动作的步调是不一致的
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（93）随机存储器是一种只能读出，不能写入的存储器
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（94）通用阵列逻辑(GAL)器件是一种可用电擦除的,但是不可重复编程的高速PLD
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（95）FPGA是ASIC电路中设计周期最长、开发费用最高、风险最小的器件之一
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（96）当传送十进制数5时，在8421奇校验码的校验位上值应为1。
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（97）单稳态电路只有一个稳定状态，另一个是暂稳态
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（98）对于很高分辨率的DAC其精度一定很高
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（99）FPGA有多种配置模式，并行主模式为一片FPGA加一片EPROM的方式
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（100）施密特触发器可将任意波形变换成矩形脉冲
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（101）FPGA有多种配置模式，串行模式可以采用串行PROM编程FPGA
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（102）用2片容量为16K8的RAM构成容量为32K8的RAM是位扩展
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（103）同步触发器存在空翻现象,而边沿触发器和主从触发器克服了空翻
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（104）偏移误差是指输入信号为零时，输出信号的偏移值
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（105）根据输出信号的特点，可以把时序逻辑电路分为Mealy型和Moore型
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（106）多谐振荡器有两个稳态
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（107）在组合逻辑电路中，任一时刻的输出信号不仅和当时的输入信号有关，而且还与原来的状有关
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（108）线性度也称非线性度。是指ADC实际的转移函数与理想直线的最大偏移。它包括量化误差
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（109）ROM和RAM中存入的信息在电源断掉后都不会丢失
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（110）多谐振荡器产生矩形波脉冲信号
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（111）ADC的主要技术指标有分辨率、量化误差、线性度偏移误差
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（112）硬件描述语言(HDL，Hardware Description Language)是一种能够以形式化描述电路结构和行为并用于模拟和综合的高级描述语言
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（113）存储器字数的扩展可以利用外加译码器控制数个芯片的片选输入端来实现
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（114）RAM的典型结构由地址译码、存储矩阵和读控制三部分组成
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（115）单稳态电路在触发信号作用下，可从暂稳态进入稳态
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