新奥鹏教育中国地质大学(北京)《数字电路与逻辑设计(新)》在线作业二

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地大《数字电路与逻辑设计(新)》在线作业二-0010

为实现将JK触发器转换为D触发器，应使（ ）
A:J=D,K=/D
B:K=D,J=/D
C:J=K=D
D:J=K=/D
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一个无符号10位数字输入的DAC，其输出电平的级数为（ ）
A:4
B:10
C:1024
D:1023
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对TTL与非门多余输入端的处理，不能将它们( )
A:与有用端连在一起
B:悬空
C:接高电平
D:接地
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以下代码中为恒权码的为( ).
A:循环码
B:5421BCD码
C:余三码
D:格雷码
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对于JK触发器，若J=K，则可完成（ ）触发器的逻辑功能
A:RS
B:D
C:T
D:T'
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PLD的每个输出都是输入的（ ）
A:与或函数
B:与非函数
C:或非函数
D:与、或、非函数
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101键盘的编码器输出（ ）位二进制代码
A:2
B:6
C:7
D:8
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同步时序电路和异步时序电路比较，其差异在于后者 ( )。
A:没有触发器
B:没有统一的时钟脉冲控制
C:没有稳定状态
D:输出只与内部状态有关
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以下电路中，加以适当辅助门电路，（ ）适于实现单输出组合逻辑电路
A:奇偶校验器
B:数据选择器
C:数值比较器
D:七段显示译码器
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与十进制数（53.5）10等值的数或代码为（ ）
A:(11010011.0101)8421BCD
B:(36.8)16
C:(110101.1)2
D:(55.4)8
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对于T触发器，若原态Qn=1，欲使新态Qn+1=1，应使输入T=（ ）
A:0或/Q
B:1
C:Q
D:/Q
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在下列触发器中，有约束条件的是（ ）
A:主从JK F/F
B:主从D F/F
C:同步RS F/F
D:边沿D F/F
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下列触发器中，没有约束条件的是（ ）
A:基本RS触发器
B:主从RS触发器
C:同步RS触发器
D:边沿D触发器
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欲使JK触发器按Qn+1=1工作，可使JK触发器的输入端（ ）
A:J=K=1
B:J=1,K=0
C:J=K=/Q或B
D:J=K=0
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一个无符号8位数字量输入的DAC，其分辨率为（ ）位
A:1
B:3
C:4
D:8
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用数据选择器可实现时序逻辑电路。（ ）
A:错误
B:正确
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卡诺图化简法可以更加直观、简捷的逻辑函数化简方法。（ ）
A:错误
B:正确
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合逻辑电路中产生竞争冒险的主要原因是输入信号受到尖峰干扰。（ ）
A:错误
B:正确
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八进制数（18）8比十进制数（18）10小。（ ）
A:错误
B:正确
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逻辑变量的取值虽然只有0或1两奥鹏教育中国地质大学在线作业种可能，但其也有大小和正负之分。
A:错误
B:正确
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OC门，即集电极开路门，是一种能够实现线逻辑的电路。（ ）
A:错误
B:正确
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反码的符号位用0正，用1表示负。
A:错误
B:正确
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占空比的公式为：q = t w / T，则周期T越大占空比q越小。（ ）
A:错误
B:正确
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74LS147为8-3线优先编码器。（ ）
A:错误
B:正确
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A/D转换器广泛应用于I/O接口电路及数字化仪表中.
A:错误
B:正确
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