北理工《DSP原理及应用》在线作业五

奥鹏北京理工大学新学期作业参考

北理工《DSP原理及应用》在线作业-00005

1.单片机通过HPI接口可以访问TMS320VC5402的全部（）字数据存储空间。
选项A：16K
选项B：32K
选项C：64K
选项D：128K
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2.TMS320C54XDSP共有129条指令，分为（）大类。
选项A：6
选项B：5
选项C：4
选项D：3
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3.对于线性时不变（LTI）系统，如果输入x(n)时，输出y(n)；则输入2x(n-3)时，输出为（ ）
选项A：y(n-3)
选项B：3y(n-2)
选项C：2y(n-3)
选项D：2y(n)
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4.TMS320C54XDSP定时器周期寄存器是（）。
选项A：IFR
选项B：IMR
选项C：PRD
选项D：SWWWSR
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5.TMS320C54XDSP采用改进的哈佛结构，围绕（）组16位总线建立。
选项A：8
选项B：16
选项C：4
选项D：24
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6.TMS320C54XDSP软硬件复位时，中断向量为（）。
选项A：FF00H
选项B：FF80H
选项C：0080H
选项D：0000H
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7.从数据总线的宽度来说，TMS320VC5402PGE100是（）位的DSP存储器；
选项A：16
选项B：32
选项C：8
选项D：24
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8.下列属于数字信号特征的是( )
选项A：时间离散、幅值连续
选项B：时间连续、幅值连续
选项C：时间连续、幅值量化
选项D：时间离散、幅值量化
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9.TMS320C54XDSP多通道缓冲串口（MCBSP）发送和接收通道数最多可达（）路。
选项A：128
选项B：64
选项C：32
选项D：16
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10.当硬件复位后，CPU将从下列哪个地址开始执行程序。（）
选项A：0FF80H
选项B：0000H
选项C：0080H
选项D：0FF00H
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11.在块循环中用于确定一块代码所需要循环次数的寄存器是（）
选项A：RSA
选项B：BRC
选项C：REA
选项D：RBC
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12.TMS320C54x中累加器A分为三个部分，低位字，高位字和保护位，其中A的高位字是指（）
选项A：AL
选项B：AG
选项C：AH
选项D：AM
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13.TMS320C54XDSP主机接口HPI是（）位并行口。
选项A：32
选项B：16
选项C：8
选项D：2
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14.TMS320C54XDSP具有多种不同的节电工作方式，其中（）不仅使DSP片上的CPU和外设暂停工作，还停止片上的PLL，显著降低功耗。
选项A：HOLD
选项B：IDLE1
选项C：IDLE2
选项D：IDLE3
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15.TMS320C54XDSP中有（）个辅助寄存器。
选项A：4
选项B：8
选项C：16
选项D：32
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16.DSP处理器中断系统如何清除中断标志？（）
选项A：软件和硬件复位，即C54x的复位引脚RS=0；
选项B：相应的IFR标志位置1；
选项C：使用相应的中断号响应该中断，即使用INTR #K指令。
选项D：相应的IFR标志位置0；
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17.下面对TMS320C54xDSP的堆栈操作说法，错误的是（）
选项A：出栈操作时，数据先出栈，然后SP增加
选项B：出栈操作时，SP先增加，然后数据出栈
选项C：当进栈操作时，SP先增加，然后数据进入堆栈
选项D：当进栈操作时，数据先进入堆栈，然后SP减小。
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18.下面对一些常用的伪指令说法错误的是：（）
选项A：.def所定义的符号，是在当前模块中使用，在别的模块中定义的符号；
选项B：.ref所定义的符号，是当前模块中定义，并可在别的模块中使用的符号；
选项C：.sect命令定义的段是未初始化的段；
选项D：.usect命令定义的段是未初始化的段。
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19.TMS320C54X的3个状态控制寄存器包括（）
选项A：ST0
选项B：ST1
选项C：T
选项D：PMST
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20.程序计数器的值可以通过（）等操作改变。
选项A：复位操作、顺序执行指令
选项B：分支转移、累加器转移
选项C：块重复、子程序调用
选项D：从累加器调用子程序、中断
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21.可编程dsp芯片有哪些特点？（）
选项A：快速的指令周期
选项B：硬件配置强
选项C：支持多处理器结构
选项D：省电管理和低功耗
选项E：采用流水线技术
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22.C54xDSP存储空间由三个独立的可选择空间组成（）
选项A：数据空间
选项B：程序空间
选项C：I/O空间
选项D：外部空间
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23.TMS320C54xDSP芯片四种串行口类型是指（）
选项A：SP
选项B：BSP
选项C：McBSP
选项D：TDMcBSP
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24.下列哪些不是TMS320C54XDSP的中断标志寄存器（）
选项A：IFR
选项B：TCR
选项C：PRD
选项D：TIM
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25.dsp技术的发展趋势主要体现在什么方面？（）
选项A：DSP和微处理器的融合
选项B：DSP和高档CPU的融合
选项C：DSP和SOC的融合
选项D：DSP和FPGA的融合
选项E：DSP的并行处理结构
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26.哈佛结构的特点是数据总线和程序总线分开。
选项A：错误
选项B：正确
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27.TMS320C55X DSP的40位ALU和累加器，仅支持16位算术运算。
选项A：错误
选项B：正确
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28.C54x系列DSP处理器中，实现时钟频率倍频或分频的部件是锁相环PLL。
选项A：错误
选项B：正确
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29.3.3V的TTL电平器件可以直接驱动5V的CMOS器件。
选项A：错误
选项B：正确
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3奥鹏北京理工大学新学期作业参考0.直接寻址中从页指针的位置可以偏移寻址64个单元。
选项A：错误
选项B：正确
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31.DSP的工作频率只能是外部晶体振荡器的频率。
选项A：错误
选项B：正确
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32.循环缓冲区是一个滑动窗，包含最近的数据，若有新的数据到来，它将覆盖旧的数据。
选项A：错误
选项B：正确
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33.DSP 处理器TMS320VC5402内部含有SARAM存储器。
选项A：错误
选项B：正确
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34.如果OVLY=1，程序存储空间可以使用内部RAM，此时，不论XPC为何值，扩展程序存储空间的所有低32K字都被映像到内部RAM中。
选项A：错误
选项B：正确
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35.浮点DSP与定点DSP相比，价格便宜、功耗较小、运算精度稍低。
选项A：错误
选项B：正确
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